| 高性能模擬與混合信號IC領(lǐng)導廠(chǎng)商Silicon Labs（芯科實(shí)驗室有限公司）日前宣布針對消費電子和嵌入式應用推出業(yè)界最小尺寸的符合PCI Express（PCIe）標準的時(shí)鐘發(fā)生器芯片，在這些應用中可靠性、板面積、器件數量和功耗通常是其關(guān)鍵設計要素。設計旨在滿(mǎn)足PCIe Gen 1/2/3標準的嚴格規范，新型的Si50122時(shí)鐘憑借Silicon Labs低功耗PCIe和CMEMS技術(shù)為各類(lèi)應用提供了節能、免片外晶體的時(shí)鐘解決方案，這些應用包括數字錄像機和靜態(tài)照相機、IP機頂盒、高清視頻流播放機、高清晰度數字電視、家庭娛樂(lè )和音頻系統、多功能打印機、消費類(lèi)和小型商業(yè)存儲設備、家庭網(wǎng)關(guān)和無(wú)線(xiàn)接入設備等。
Si50122是第一個(gè)集成Silicon Labs CMEMS專(zhuān)利技術(shù)的時(shí)鐘發(fā)生器芯片。片內的CMEMS諧振器為芯片內的CMOS時(shí)鐘電路提供了一個(gè)穩定的頻率參考，省去了通常所需的大體積、分立的石英晶體。通過(guò)利用CMEMS技術(shù)，Si50122 PCIe時(shí)鐘提供了極佳的抗沖擊和抗振動(dòng)性，即使在惡劣的條件下（例如極端溫度變化）也能夠確保高可靠性并保證性能。手持消費電子產(chǎn)品容易遭遇碰撞或跌落的情況，使用穩固的CMEMS PCIe時(shí)鐘發(fā)生器而不是基于晶體的解決方案，能夠消除由于石英諧振器損壞而導致系統故障的風(fēng)險。
支持極小的2mm x 2.5mm 10引腳TDFN封裝，Si50122是業(yè)內現有的最小尺寸的PCIe時(shí)鐘發(fā)生器，也是業(yè)內最低功耗的免片外晶體的PCIe時(shí)鐘解決方案。結合了業(yè)內領(lǐng)先的小尺寸和超低功耗，Si50122成為采用PCIe互聯(lián)標準的空間受限的手持和電池供電型消費電子和嵌入式應用的最佳解決方案。
為了降低系統成本、功耗和器件數量并簡(jiǎn)化電路板設計，Si50122 PCIe時(shí)鐘發(fā)生器采用了低功耗的“推挽（Push-pull）”式HCSL輸出緩沖器，省去了HCSL輸出通常所需的所有外部終端電阻。而競爭對手芯片通常使用傳統的輸出緩沖器架構，其需要1個(gè)電源電阻器以及每個(gè)輸出端口上多達4個(gè)終端電阻器，這迫使設計人員在使用2路輸出器件時(shí)要管理多達9個(gè)片外電阻器。通過(guò)省去眾多的片外器件，推挽技術(shù)使得設計人員能夠在輸出引腳和接收器之間使用直連線(xiàn)，從而獲得更可靠的信號完整性。其他大多數PCIe時(shí)鐘供應商通常采用傳統的恒流（constant-current）技術(shù)，相較之下，在輸出緩沖器中采用推挽技術(shù)功耗可降低60%以上。
Si50122 PCIe時(shí)鐘芯片提供2路低功耗100MHz差分HCSL輸出和1路25MHz LVCMOS時(shí)鐘輸出。由于它是免片外晶體的解決方案，因此它不需要片外25MHz參考時(shí)鐘源。正如Silicon Labs全部的PCIe計時(shí)IC產(chǎn)品組合一樣，Si50122芯片完全超越了PCIe Gen 1/2/3標準中對于抖動(dòng)性能的要求，并且支持可選的擴頻調制功能以進(jìn)一步降低電磁干擾（EMI）。
Silicon Labs計時(shí)產(chǎn)品營(yíng)銷(xiāo)總監James Wilson表示，“隨著(zhù)當今功耗和空間受限的消費電子和嵌入式產(chǎn)品不斷采用PCIe標準，開(kāi)發(fā)人員需要新一代PCIe時(shí)鐘解決方案以最小化功耗、BOM數量和電路板面積。我們設計新型的基于CMEMS的免片外晶體Si50122 PCIe時(shí)鐘，旨在為快速擴展的PCIe市場(chǎng)提供高集成度、低功耗、高可靠性和設計的簡(jiǎn)易化”。
價(jià)格和供貨
Si50122 PCIe時(shí)鐘發(fā)生器現在已經(jīng)量產(chǎn)，可提供樣片。在一萬(wàn)片采購量時(shí)單價(jià)為0.77美元。為了加速PCIe應用開(kāi)發(fā)，Silicon Labs還提供了Si50122-Ax-EVB評估板，零售價(jià)格為125美元。 |
